libc/private/bionic_atomic_x86.h

   1 /*
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  15  */
  16 #ifndef BIONIC_ATOMIC_X86_H
  17 #define BIONIC_ATOMIC_X86_H
  18
  19 /* Define a full memory barrier, this is only needed if we build the
  20  * platform for a multi-core device.
  21  */
  22 __ATOMIC_INLINE__ void __bionic_memory_barrier() {
  23   __asm__ __volatile__ ( "mfence" : : : "memory" );
  24 }
  25
  26 /* Compare-and-swap, without any explicit barriers. Note that this function
  27  * returns 0 on success, and 1 on failure. The opposite convention is typically
  28  * used on other platforms.
  29  */
  30 __ATOMIC_INLINE__ int __bionic_cmpxchg(int32_t old_value, int32_t new_value, volatile int32_t* ptr) {
  31     int32_t prev;
  32     __asm__ __volatile__ ("lock; cmpxchgl %1, %2"
  33                           : "=a" (prev)
  34                           : "q" (new_value), "m" (*ptr), "0" (old_value)
  35                           : "memory");
  36     return prev != old_value;
  37 }
  38
  39 /* Swap, without any explicit barriers. */
  40 __ATOMIC_INLINE__ int32_t __bionic_swap(int32_t new_value, volatile int32_t *ptr) {
  41   __asm__ __volatile__ ("xchgl %1, %0"
  42                         : "=r" (new_value)
  43                         : "m" (*ptr), "0" (new_value)
  44                         : "memory");
  45   return new_value;
  46 }
  47
  48 /* Atomic decrement, without explicit barriers. */
  49 __ATOMIC_INLINE__ int32_t __bionic_atomic_dec(volatile int32_t* ptr) {
  50   int increment = -1;
  51   __asm__ __volatile__ ("lock; xaddl %0, %1"
  52                         : "+r" (increment), "+m" (*ptr)
  53                         : : "memory");
  54   /* increment now holds the old value of *ptr */
  55   return increment;
  56 }
  57
  58 #endif /* BIONIC_ATOMIC_X86_H */