Basic-Test-Package/MSP432/Test_MSP432_WakeUp/I3MSP432P401R.cmd

   1 /*
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  30  * EVEN IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.
  31  */
  32 /*
  33  *  ======== MSP_EXP432P401R.cmd ========
  34  *  Define the memory block start/length for the MSP_EXP432P401R M4
  35  */
  36
  37 MEMORY
  38 {
  39     MAIN       (RX) : origin = 0x00000000, length = 0x00040000
  40     INFO       (RX) : origin = 0x00200000, length = 0x00004000
  41     SRAM_CODE  (RWX): origin = 0x01000000, length = 0x00010000
  42     SRAM_DATA  (RW) : origin = 0x20000000, length = 0x00010000
  43 }
  44
  45 /* Section allocation in memory */
  46
  47 SECTIONS
  48 {
  49     .text   :   > MAIN
  50     .const  :   > MAIN
  51     .cinit  :   > MAIN
  52     .pinit  :   > MAIN
  53
  54 #ifdef __TI_COMPILER_VERSION__
  55 #if __TI_COMPILER_VERSION__ >= 15009000
  56     .TI.ramfunc : {} load=MAIN, run=SRAM_CODE, table(BINIT)
  57 #endif
  58 #endif
  59     .data   :   > SRAM_DATA
  60     .bss    :   > SRAM_DATA
  61     .sysmem :   > SRAM_DATA
  62     .stack  :   > SRAM_DATA (HIGH)
  63 }
  64
  65 /* Symbolic definition of the WDTCTL register for RTS */
  66 WDTCTL_SYM = 0x4000480C;