libs/system/zc702evk/nucleus/bsp/zc702evk_defs.h

   1 /***********************************************************************\r
   2 *\r
   3 *             Copyright 2013 Mentor Graphics Corporation\r
   4 *                         All Rights Reserved.\r
   5 *\r
   6 * THIS WORK CONTAINS TRADE SECRET AND PROPRIETARY INFORMATION WHICH IS\r
   7 * THE PROPERTY OF MENTOR GRAPHICS CORPORATION OR ITS LICENSORS AND IS\r
   8 * SUBJECT TO LICENSE TERMS.\r
   9 *\r
  10 ************************************************************************\r
  11 \r
  12 ************************************************************************\r
  13 *\r
  14 *   FILE NAME\r
  15 *\r
  16 *       zc702evk_defs.h\r
  17 *\r
  18 *   DESCRIPTION\r
  19 *\r
  20 *       This file contains platform definitions for the Xilinx ZC702 EVK board\r
  21 *\r
  22 *   DATA STRUCTURES\r
  23 *\r
  24 *       None\r
  25 *\r
  26 *   DEPENDENCIES\r
  27 *\r
  28 *       None\r
  29 *\r
  30 ***********************************************************************/\r
  31 \r
  32 #ifndef         ZC702EVK_DEFS_H\r
  33 #define         ZC702EVK_DEFS_H\r
  34 \r
  35 /* Define the board clock rate (in hertz).\r
  36    NOTE: This clock rate is used to calculate the rate of the OS timer.\r
  37          Therefore, if multiple clock sources are fed to the processor,\r
  38          this clock rate value must represent the source used\r
  39          by the on-chip timer unit. */\r
  40 #define         ESAL_DP_REF_CLOCK_RATE                  33333333UL\r
  41 \r
  42 /* Define number of memory regions contained on the given development platform */\r
  43 #define         ESAL_DP_MEM_NUM_REGIONS                 6\r
  44 \r
  45 /* Define if an interrupt controller (off processor) exists on the board and\r
  46    controlling / handling of interrupts from this interrupt controller must\r
  47    be accommodated for.  Setting this to NU_FALSE means off-chip interrupts\r
  48    will NOT be controlled or handled.  Setting this to NU_TRUE means off-chip\r
  49    interrupts will be controlled and handled */\r
  50 #define         ESAL_DP_INTERRUPTS_AVAILABLE            NU_FALSE\r
  51 \r
  52 /* Define the base of address on-chip peripheral registers */\r
  53 #define         ESAL_DP_PERIPH_BASE                     0xE0000000\r
  54 \r
  55 /* Define ESAL interrupt vector IDs for this development platform.\r
  56    These IDs match up with development platform interrupts.\r
  57    Values correspond to the index of entries in ESAL_GE_ISR_Interrupt_Handler[].\r
  58    Names are of the form ESAL_DP_<Name>_INT_VECTOR_ID, where <Name> comes\r
  59    directly from the hardware documentation */\r
  60 \r
  61 \r
  62 /* Define the last ESAL interrupt vector ID for this development platform + 1 */\r
  63 #define         ESAL_DP_INT_VECTOR_ID_DELIMITER         (ESAL_PR_INT_VECTOR_ID_DELIMITER + 1)\r
  64 \r
  65 /* Define the system level control registers address*/\r
  66 #define         ESAL_DP_SLCR_BASE                       0xF8000000\r
  67 \r
  68 \r
  69 #endif  /* ZC702EVK_DEFS_H */\r